Eu vou fazer programação em verilog, vhdl, systemverilog e rtl para fpga no vivado, quartus e xilinx

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Engenheiro de FPGA e Design RTL, Verilog VHDL SystemVerilog Vivado

Engenheiro de FPGA & RTL Design | Mais de 4 anos | Verilog, VHDL, SystemVerilog, Vivado Eu projeto, verifico e depuro sistemas digitais confiáveis para startups, pesquisadores e engenheiros ao redor ...
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Sobre este Serviço

Procurando um especialista confiável em FPGA, Verilog, VHDL ou SystemVerilog? Você está no lugar certo.


Sou um Engenheiro de Design de Hardware com mais de 4 anos de experiência na indústria em design de FPGA, codificação RTL, simulação e verificação. Já entreguei projetos para a SWARM (defesa e RF), ERAYS Technologies e o Instituto Nacional de Eletrônica.


O que eu entrego:

Codificação RTL em Verilog, SystemVerilog, VHDL

Design de FPGA no Vivado, Quartus, Xilinx ISE, Vitis HLS

Testbenches, verificação UVM, ModelSim, QuestaSim

Zynq SoC, MicroBlaze, protocolos AXI, I2C, SPI, UART

Cores IP personalizadas, FSMs, pipelines, FIFOs, controladores de memória

Fechamento de timing, síntese, place and route, bitstream

PetaLinux, TCL, Git, RFSoC, ADRV9001


Placas: Nexys A7, Basys 3, Zybo, ZedBoard, ZC706, DE10-Lite.


Por que me escolher:

Código limpo, documentado e sintetizável

Entrega pontual e revisões até você ficar satisfeito

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Plataforma:

FPGA

Especialidade:

Depuração

•

Otimização de SoC

•

testando

•

Programação

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