Eu vou desenvolver seu software em C++, algoritmos e projetos de POO

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Muhammad Ramish
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Sobre este Serviço

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Construo aplicações em C++ de alto desempenho, ferramentas e modelos de simulação do começo ao fim. Você fornece os requisitos ou especificações do projeto, e eu entrego um código limpo, compatível com os padrões, eficiente, bem testado e fácil de manter.


O que posso construir:

- Utilitários de linha de comando em C++ e softwares de console (C++11/14/17 moderno)

- Arquitetura orientada a objetos (classes, templates, smart pointers, padrões de projeto)

- Estruturas de dados, algoritmos personalizados e modelagem numérica

- Modelos de referência de software, simuladores ISA e lógica de manipulação de bits

- Correção de bugs, resolução de vazamentos de memória e refatoração de código


Como trabalho:

1. Você compartilha suas especificações, requisitos ou código inicial

2. Confirmamos o escopo, configuração do projeto, preço e prazo

3. Eu construo, depuro e testo o projeto

4. Você recebe código limpo, scripts de build (CMake/Makefile) e um guia de configuração


Cada pedido inclui:

- Código C++ legível, padrão PEP/ISO

- Testes unitários ou scripts de teste para verificar a lógica

- Instruções claras de compilação e execução

- Revisões dentro do escopo acordado


Sobre mim: mais de 3 anos como engenheiro usando C++ para modelagem de conjunto de instruções, algoritmos e simulação de software, junto com SystemVerilog e Python.

Conheça mais sobre Muhammad Ramish

Muhammad Ramish

ASIC Digital Design and Verification Engineer

  • A partir dePaquistão
  • Membro desdeset. de 2026
  • Responde em aprox.:1 hora
  • Idiomas

    Inglês, Urdu
I'm a digital design and verification engineer with 3+ years of ASIC and FPGA experience. I mostly work in SystemVerilog, with Python and C++ for reference models and scripting. I've used Synopsys VCS, Cadence Xcelium and Vivado for simulation, and I'm comfortable with AXI4, RISC-V and lint cleanup. I can build testbenches from scratch, debug failing RTL from waveforms, write Makefile-based flows, and model behaviour in Python before RTL. I am well equipped for both verification and design related tasks.

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