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Vou projetar um controlador i2c, spi ou uart para o seu fpga
Engenheiro de Verificação RTL e Design de FPGA
Engenheiro de Design e Verificação de ASIC com mais de 3 anos de experiência na indústria em verificação RTL e fechamento de timing, incluindo um tape-out de 12nm. Ajudo equipes de hardware, startups ...
Sobre este Serviço
Eu projeto e verifico controladores de protocolos seriais em Verilog/SystemVerilog, mirando FPGAs Xilinx com o Vivado.
O que você recebe:
- RTL sintetizável para I2C, SPI ou UART (mestre/escravo conforme necessário)
- bancada de testes com autoverificação e resultados de simulação
- parâmetros configuráveis (taxa de baud, divisor de clock, largura de dados)
- arquivos prontos para Vivado e um guia rápido de integração
Eu implementei esses controladores em um sistema de memória mapeada funcional no Artix-7. Diga-me o protocolo, a frequência do clock e quaisquer requisitos especiais.
