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Vou fazer verificação RTL e design físico de ASIC
Engenheiro de Design RTL FPGA Verilog SystemVerilog UVM RISC V
Oi! Eu sou Jamshaid Abbas, um engenheiro elétrico apaixonado e detalhista, com experiência prática em:
✅ Design e simulação de circuitos (Proteus, Multisim, PSpice, MATLAB)
✅ Design de processador RIS...
Sobre este Serviço
Você está procurando suporte profissional em design de ASIC, verificação RTL ou design físico?
Sou engenheiro elétrico com experiência prática em design de IC digital, verificação SystemVerilog/UVM e fluxos de design RTL para GDSII.
Meus serviços incluem:
- Especificações até RTL Verilog/SystemVerilog sintetizável
- Desenvolvimento, depuração e otimização de RTL
- Testbenches simples direcionados e de auto-verificação
- Desenvolvimento de testbench UVM, agentes, sequências, drivers, monitores e scoreboards
- Assertions SystemVerilog (SVA) e análise de cobertura
- Simulação funcional e testes de regressão
- Síntese lógica, análise de timing e área
- Design físico: floorplanning, placement, CTS, roteamento e relatórios de implementação
Ferramentas:
Cadence Xcelium, Genus, Innovus e fluxos open-source adequados usando Yosys, OpenROAD, Verilator ou Icarus Verilog.
Entregáveis: arquivos RTL/testbench, scripts, resultados de simulação, relatórios de verificação e saídas de design físico aplicáveis.
Trabalho dependente de ferramentas comerciais e PDK requer acesso licenciado adequado.
Por favor, entre em contato comigo com suas especificações antes de fazer um pedido.
Meu portfólio
Perguntas frequentes
Tradução automática
Você consegue desenvolver testbenches simples e baseados em UVM?
Sim. Posso criar testbenches direcionados, com auto-verificação em SystemVerilog, e ambientes de verificação estruturados em UVM, de acordo com a complexidade do projeto.
Você consegue usar ferramentas da Cadence e de código aberto?
Sim, a abordagem de implementação pode usar Cadence Xcelium, Genus, Innovus ou alternativas de código aberto adequadas. Ferramentas comerciais exigem acesso com licença válida, e os resultados de design físico dependem dos arquivos de tecnologia fornecidos.
