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Eu vou arquitetar e desenvolver fpga, zynq soc, axi, dma e embedded linu
Mais de 5 anos de experiência em projeto de sistemas embarcados, projeto de PCB e prototipagem de produtos. Projete e implemente sistemas embarcados do zero ou atualize sistemas existentes. Projete PC...
Sobre este Serviço
Ofereço desenvolvimento sênior de FPGA e Zynq SoC, abrangendo SystemVerilog RTL, IPs personalizados, AXI4-Lite, AXI4-Stream, DMA, DDR, integração PS/PL, PetaLinux, fechamento de timing, verificação e depuração de hardware com ILA.
Os projetos podem variar desde blocos RTL/IP individuais até arquiteturas completas de embedded SoC, integrando processadores ARM, lógica programável, caminhos de dados de alta velocidade e sensores/periféricos externos.
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Perguntas frequentes
Tradução automática
Quais plataformas de FPGA e SoC você suporta?
Principalmente trabalho com plataformas AMD/Xilinx FPGA e Zynq, incluindo Zynq-7000 e Zynq UltraScale+ MPSoC. Outros dispositivos podem ser considerados se a toolchain, arquivos do dispositivo e informações do projeto estiverem disponíveis.
Você pode trabalhar em um projeto existente no Vivado ou RTL?
Sim. Posso revisar, depurar, expandir ou reestruturar RTL em Verilog/SystemVerilog, projetos Vivado, designs de blocos, restrições XDC, IPs personalizados e ambientes de simulação existentes.
Você consegue projetar um sistema completo PS/PL Zynq?
Sim. Posso definir a partição PS/PL, integrar o Sistema de Processamento, criar hardware PL personalizado, conectar interfaces AXI, configurar clocks/resets, definir mapas de registros e preparar a interface hardware/software.
Você desenvolve periféricos personalizados AXI4-Lite ou AXI4-Stream?
Sim. Posso projetar periféricos de controle/estado AXI4-Lite, caminhos de dados AXI4-Stream e mapas de registros de suporte, FIFOs, interrupções e lógica de handshake de protocolo.
Você consegue integrar DMA e DDR para transferência de dados de alta velocidade?
Sim. Posso arquitetar caminhos de dados PL-para-DDR e DDR-para-PL usando AXI-Stream, AXI DMA, buffers e DDR conectado ao PS, para que transferências grandes de dados não dependam do ARM CPU copiando cada palavra manualmente.
Você suporta integração com PetaLinux e Linux embarcado?
Sim. Quando necessário, posso suportar integração XSA/BSP, configuração de device-tree, periféricos FPGA visíveis pelo Linux, acesso a registros mapeados na memória, integração de boot e controle de hardware PL a nível de aplicação.
Você consegue interfacear sensores, ADCs, motores ou módulos de comunicação?
Sim. Interfaces típicas incluem SPI, I2C, UART, GPIO, aquisição ADC, PWM, encoders e interfaces digitais personalizadas. Por favor, forneça as fichas técnicas dos dispositivos e requisitos elétricos/de interface.
Você realiza síntese, implementação e fechamento de timing?
Sim. Posso realizar síntese, colocação e roteamento, configuração de restrições XDC, análise de setup/hold, revisão de Slack, verificações de clock/CDC, análise de utilização e fechamento de timing em nível de implementação.
Você pode ajudar com prototipagem FPGA-para-ASIC?
Sim. Posso estruturar RTL e verificação para que o FPGA sirva como um protótipo prático para um fluxo orientado a ASIC posteriormente. O fluxo de implementação de ASIC é separado, mas a validação no FPGA é útil para comprovar arquitetura digital e funcionalidade antes do silicon.
