Farei design RTL em verilog ou systemverilog para sua necessidade

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Abdullah Bhutta

Paquistão

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Sobre este Serviço

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Sou especializado em escrever RTL limpo usando Verilog ou SystemVerilog. Seja para criar um módulo do zero, depurar um design existente ou desenvolver um banco de testes de verificação completo, posso oferecer soluções eficientes e bem documentadas.

Serviços que ofereço

  1. Design RTL em Verilog & SystemVerilog
  2. Design de lógica combinacional & sequencial
  3. Máquinas de estado finito (FSM - Mealy & Moore)
  4. Contadores, registradores, shift registers, multiplexers, ALU, FIFO, memória, UART, SPI, I2C e circuitos digitais personalizados
  5. Módulos RTL parametrizados
  6. Desenvolvimento de Testbench SystemVerilog
  7. Simulação funcional & depuração
  8. Análise de waveform e correção de bugs
  9. Código sintetizável pronto para FPGA

Ferramentas:

  1. Cadence Xcelium
  2. Xilinx Vivado


Antes de fazer seu pedido, entre em contato comigo para discutir os requisitos do seu projeto, assim poderei oferecer a melhor solução para seu design.

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Plataforma:

Outros

Especialidade:

Desenvolvimento de firmware

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